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  3. chipverse_
Designing something small often teaches the biggest lessons. Recently, I worked on a compact USB Type-C PCB design using EasyEDA. The goal was to understand practical routing, component placement, an
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🚀 My First PCB Design in KiCad! I designed an AC to DC converter using a bridge rectifier and filter capacitor. This is my first step into PCB design and hardware development. 🔧 Tools Used: KiCad
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Designed and implemented a 5V regulated power supply using bridge rectifier and 7805 voltage regulator. 🔹 Designed schematic and PCB using EasyEDA 🔹 Converted AC to stable DC output 🔹 Implemented
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Completed FPGA-based 2x1 MUX Design Today I completed the design and verification of a 2×1 Multiplexer (MUX) using Verilog HDL on Xilinx Vivado. Work carried out: • RTL design using behavioral Ver
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Designed and functionally verified a 4×1 Multiplexer using hierarchical 2×1 MUX blocks at 45 nm technology node. The implementation follows a modular digital design methodology and functional correctn
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Today I completed a 2×1 CMOS MUX design using the 45 nm GPDK45 PDK on Cadence Virtuoso. VDD = 1.0 V | W = 120 nm | L = 45 nm | m = 1 Tested with 0-1 V pulse inputs (tr = 100 ps) and verified correct s
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Today I completed and shared my 4-bit adder project in Vivado 2025. Designed using Xilinx IP Catalog, wrapped with Verilog, simulated with custom test vectors, and verified through behavioral waveform
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Full Adder implemented and simulated in Vivado. Testbench + waveform verification done. Step-by-step getting deeper into digital logic and FPGA workflows. #VLSI #FPGA #Vivado #Verilog #Engineering
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Completed my Half Adder design today in Vivado using Verilog. Generated the RTL schematic and verified the logic for Sum and Carry. Next step: Full Adder and simulation workflow. #Vivado #Verilog #VLS
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Billions of transistors. Microscopic wires. Clock pulses. Logic paths. All synced inside a few mm² of silicon. That’s the magic of VLSI. #technology #electronics #microchips #innovation #futuretech
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VLSI = Very Large Scale Integration It is the semiconductor design methodology that allows high transistor density and integration on silicon. VLSI enables microprocessors, SoCs, SRAM, GPUs, RF trans
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CMOS Inverter Layout – 45nm Designed and verified in Cadence Virtuoso using GPDK45. DRC + Extract + LVS clean. Next: post-layout simulation. #VLSI #Cadence #ASIC #Semiconductor #LayoutDesign GPdk45 ED
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À propos de @chipverse_

CircuitCrafted est un créateur en croissance Instagram. Avec 275 abonnés et 15 publications, le compte de chipverse_ affiche un ratio abonnés/abonnements de 0.5:1. Voir tout le contenu anonymement sur Pictame - aucune connexion requise.

Le taux d'engagement de chipverse_ est de 7.27%. C'est 45% au-dessus de la moyenne pour les comptes avec 1K-10K abonnés (5%) — signe d'une audience vraiment connectée.

Sur les 12 dernières publications, 25% sont des vidéos et 75% des photos. À noter que les vidéos génèrent 1.3x plus d'engagement que les photos. Le contenu apparaît à peu près tous les 8 jours. Les légendes sont plutôt de longueur moyenne, avec environ 460 caractères en moyenne.

7.27% d'engagement — 45% au-dessus de la moyenne pour les comptes 1K-10K abonnés.
25% vidéos, 75% photos. Les vidéos génèrent 1.3x plus d'engagement.
Publications environ tous les 8 jours.

Questions Fréquentes Sur @chipverse_

Avec Pictame, vous pouvez parcourir les publications, reels et stories de @chipverse_ sans vous connecter à Instagram. Le propriétaire du profil ne saura jamais que vous l'avez visité.

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